Etiqueta: conjunción lógica negada
conjunción lógica negada
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Compuerta lógica NAND Cuadruple CD4011 El dispositivo proporciona al diseñador del sistema la implementación directa de la función O de lógica positiva y complementa la familia existente de puertas CMOS. El dispositivo presenta características de salida simétricas estandarizadas y clasificaciones paramétricas de 5V, 10V y 15V.
Encapsulado: DIP14